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CAT28LV256
Figure 1. A.C. Testing Input/Output Waveform (2)
VCC - 0.3V
INPUT PULSE LEVELS
0.0 V
Figure 2. A.C. Testing Load Circuit (example)
DEVICE
UNDER
TEST
2.0 V
0.6 V
V cc
1.8K
REFERENCE POINTS
OUTPUT
28LV256 F04
1.3K
CL = 100 pF
CL INCLUDES JIG CAPACITANCE
28LV256 F05
A.C. CHARACTERISTICS, Write Cycle
V CC = 3.0V to 3.6V, unless otherwise specified
28LV256-20
28LV256-25
28LV256-30
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max. Units
t WC
t AS
t AH
t CS
t CH
t CW(3)
t OES
t OEH
t WP(3)
t DS
t DH
Write Cycle Time
Address Setup Time
Address Hold Time
CE Setup Time
CE Hold Time
CE Pulse Time
OE Setup Time
OE Hold Time
WE Pulse Width
Data Setup Time
Data Hold Time
0
100
0
0
150
0
0
150
50
0
10
0
100
0
0
150
0
0
150
50
0
10
0
100
0
0
150
0
0
150
50
0
10
ms
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t INIT(1)
t BLC(1)(4)
Write Inhibit Period After Power-up
Byte Load Cycle Time
5
0.15
10
100
5
0.15
10
100
5
0.15
10
100
ms
μ s
Note:
(1) This parameter is tested initially and after a design or process change that affects the parameter.
(2) Input rise and fall times (10% and 90%) < 10 ns.
(3) A write pulse of less than 20ns duration will not initiate a write cycle.
(4) A timer of duration t BLC max. begins with every LOW to HIGH transition of WE . If allowed to time out, a page or byte write will begin;
however a transition from HIGH to LOW within t BLC max. stops the timer.
? 2009 SCILLC. All rights reserved.
Characteristics subject to change without notice
5
Doc. No. MD-1071, Rev. E
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